陆伟成

副教授

 
 

 

简历:

陆伟成生于香港。1988年毕业于香港中文大学电子系。1993年和1996 年分别获得计算机科学与工程学系硕士学位和博士学位。 1997年赴比利时鲁汶大学(Katholieke Universiteit Leuven)作博士后。在加入复旦大学之前,曾在美国Synopsys,Inc. 公司 从事电子设计自动化(EDA)领域的研究和开发多年,并成功地把研究成果转换成产品。 目前已在国际会议及期刊发表了数十篇论文。他最近的一篇题目为《Timing Yield Driven Clock skew Scheduling Considering non-Gaussian Distributions of Critical Path Delays》将会在顶尖会议 Design Automation Conference上发表。 其中的一位评审给予高度的评价:"this paper ....overcomes the problem of non-Gaussian nature by using the CDF of the timing path and applying the reverse CDF to obtain the appropriate solution. I believe this work is technically sound and is novel enough to merit publication." 他目前的研究方向包括VLSI CAD 算法和电路模仿。

近期发表论文选录:

  • Yi Wang, Wai-Shing Luk, Xuan Zeng, Jun Tao, Changhao Yan, Jiarong Tong, Wei Cai, Jia Ni, Timing Yield Driven Clock Skew Scheduling Considering non-Gaussian Distributions of Critical Path Delays, DAC’08, USA (to appear).
  • Qiang Fu, Wai-Shing Luk, Jun Tao, Changhao Yan, Xuan Zeng. Characterizing Intra-die Spatial Correlation Using Spectral Density Method. in Proceeding of 9th International Symposium on Quality Electronic Design, USA, pp.718-723, 2008.
  • Huiping Huang, Wai-Shing Luk, Wenqing Zhao and Xuan Zeng, DME-Based Clock Routing in the Presence of Obstacles, in Proceedings of 7th International Conference on ASIC, pages 1225-1228, 2007.
  • Xuexin Liu, Wai-Shing Luk, Yu Song and Pushan Tang and Xuan Zeng, Robust Analog Circuit Sizing Using Ellipsoid Method and Affine Arithmetic, in Proceeding of the 12th Asia and South Pacific Design Automation Conference, pages 203-208, 2007.

科研项目:

  • Intel项目: 硅前验证自动化工具
  • 863项目: 90纳米工艺下的时钟树生成工具
  • 国家自然科学基金项目(申请中) : 针对超深亚微米相移掩膜技术的物理设计算法研究
  • Seiko项目(已完成): 行为级建模 

教学辅助 (01级本科生毕业论文):

  • 版图交替移相掩膜研究
  • IC设计波形模式比较算法研究
  • IC设计自动波形比较软件工具
  • GHz VLSI时钟树综合软件界面开发

教学课程建设:

  • 《程序设计》(2004)
  • 《软件基础课程》(2005)

实验室管理:

  • 软硬件配置(SUN Solaris & PC Linux)
  • EDA工具开发环境

网站:

联系方法:

  • 办公室地址: 中国上海市张衡路825号 复旦大学张江校区微电子研究院 邮编: 201203
  • 电话: +86 (21) 51355200-874
  • 电子邮件: luk (at) fudan。edu。cn
 
 

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